胡國(guó)林

摘要：提出并設(shè)計(jì)了一種應(yīng)用于CMOS全差分運(yùn)放結(jié)構(gòu)中的共模反饋電路。同傳統(tǒng)結(jié)構(gòu)的共模反饋結(jié)構(gòu)相比，該結(jié)構(gòu)能夠使輸出共模電平具有零延遲建立的特性，同時(shí)，不影響全差分運(yùn)算放大器的輸出擺幅，并且相較于傳統(tǒng)結(jié)構(gòu)，減少了開(kāi)關(guān)數(shù)量，降低了開(kāi)關(guān)電荷注入、時(shí)鐘饋通，消除了初始電荷的影響。此新型共模反饋結(jié)構(gòu)既有連續(xù)時(shí)間共模反饋速度較快、精度較高的優(yōu)點(diǎn)，又有開(kāi)關(guān)電容共模反饋輸出擺幅大線性度好的優(yōu)點(diǎn)?；贑adencespectre對(duì)電路進(jìn)行了仿真驗(yàn)證，結(jié)果表明，該結(jié)構(gòu)的共模反饋具有快速的建立時(shí)間以及較大的輸出擺幅。

關(guān)鍵詞：全差分運(yùn)算放大器；共模反饋；輸出擺幅；建立時(shí)間

DOI： 10.396 9/j.issn.1 005-5 517.201 8.7.016

0 引言

差分放大器是最重要的電路發(fā)明之一，它可以追溯到真空管時(shí)代。由于差分放大具有很多有用的特性，所以它已經(jīng)成為當(dāng)代高性能模擬電路和混合信號(hào)電路的主要選擇。而帶有共模反饋結(jié)構(gòu)的全差分運(yùn)算放大器是普遍運(yùn)用的基本電路單元，廣泛應(yīng)用于各種模擬器件中，如A/D， D/A等[1-2]。

具有高輸出擺幅、快速穩(wěn)定和高精度的全差分運(yùn)算放大器對(duì)模擬電路的設(shè)計(jì)尤為重要，而共模反饋結(jié)構(gòu)直接影響到全差分運(yùn)算放大器的各項(xiàng)性能，已有許多文章對(duì)某些性能提出了改進(jìn)的結(jié)構(gòu)[3-5]。共模反饋結(jié)構(gòu)可以分為連續(xù)時(shí)間共模反饋結(jié)構(gòu)和開(kāi)關(guān)電容共模反饋結(jié)構(gòu)。連續(xù)時(shí)間共模反饋結(jié)構(gòu)主要應(yīng)用于連續(xù)時(shí)間電路中，但是在連續(xù)時(shí)間共模反饋結(jié)構(gòu)中如果通過(guò)電阻檢測(cè)輸出共模電壓會(huì)顯著降低電路的差動(dòng)電壓增益，通過(guò)MOSFETs作為檢測(cè)器件會(huì)限制全差分運(yùn)放的輸出線性范圍。開(kāi)關(guān)電容共模反饋結(jié)構(gòu)在這幾方面具有優(yōu)勢(shì)[6]，但傳統(tǒng)開(kāi)關(guān)共模反饋結(jié)構(gòu)的共模電壓建立時(shí)間較慢，共模穩(wěn)定電壓波動(dòng)較大，且因使用較多MOS開(kāi)關(guān)而通過(guò)時(shí)鐘饋通和電荷注入引入噪聲，限制了全差分運(yùn)算放大器的速度和精度。

1 傳統(tǒng)共模反饋結(jié)構(gòu)分析

1.1傳統(tǒng)開(kāi)關(guān)電容共模反饋結(jié)構(gòu)

傳統(tǒng)的開(kāi)關(guān)電容共模反饋結(jié)構(gòu)如圖1所示。在圖1中，開(kāi)關(guān)電容共模反饋結(jié)構(gòu)包括開(kāi)關(guān)S1～S6和電容Cl-C2。開(kāi)關(guān)由兩項(xiàng)非交疊時(shí)鐘4）1和4）2控制，vo。和v。分別為全差分運(yùn)算放大器雙端輸出電壓，Vcmfb為共模反饋電流源偏置電壓，Vcm是理想共模電壓，Vbias為直流偏置電壓。

當(dāng)S1～S3閉合、S4～S6斷開(kāi)時(shí)，根據(jù)電荷分配原理，所有電容上存儲(chǔ)的總電荷為：Ql=2cl*（Vcm-Vbias）+（Vop - Vcmfb）*C2+ （Von - Vcmfb）*C2（1）

當(dāng)S1～S3斷開(kāi)、S4～S6閉合時(shí)，根據(jù)電荷分配原理，所有電容上存儲(chǔ)的總電荷為：

由式（3）可知，開(kāi)關(guān)電容共模反饋首先檢測(cè)輸出共模電壓，再與理想共模電壓比較，最后疊加一個(gè)直流偏置電壓來(lái)調(diào)節(jié)共模反饋電流源偏置電壓Vcmfb，這需要一個(gè)比較長(zhǎng)的建立時(shí)間，并且開(kāi)關(guān)數(shù)量較多，電荷注入和時(shí)鐘饋通的影響較大。

1.2傳統(tǒng)連續(xù)時(shí)問(wèn)共模反饋結(jié)構(gòu)

傳統(tǒng)的連續(xù)時(shí)間共模反饋有多種結(jié)構(gòu)，其中一種低功耗結(jié)構(gòu)如圖2所示。這里，Mi～M4都是匹配的，源耦合對(duì)Ml-M2和M3-M4一起檢測(cè)共模輸出電壓并產(chǎn)生一個(gè)與輸出共模和Vcm的差成比例的輸出電壓Vbias。

此結(jié)構(gòu)能正常工作的前提是M1～M4總工作在放大區(qū)且電壓vo。- Vcm和Von-vcm能看成是小信號(hào)輸入。即使這些電壓變大，共模反饋環(huán)路只要M1～M4仍存在就會(huì)繼續(xù)工作。若在輸出范圍的某一部分，運(yùn)算放大器輸出變得足夠大能使M1～M4中的一個(gè)截止，則在那段輸出部分共模反饋環(huán)路將不會(huì)正常工作。M1～M4在整個(gè)輸出范圍內(nèi)仍存在的要求限制了運(yùn)算放大器的輸出范圍。

2 改進(jìn)的共模反饋結(jié)構(gòu)

為了克服上述連續(xù)時(shí)間共模反饋電路輸出擺幅受限和開(kāi)關(guān)電容共模反饋電路共模電壓建立緩慢、開(kāi)關(guān)噪聲注入較大的缺點(diǎn)，提出了一種新型開(kāi)關(guān)電容共模反饋結(jié)構(gòu)，該結(jié)構(gòu)原理圖如圖3所示。

其中①部分稱為輸出電壓縮放模塊，②部分稱為共模電平檢測(cè)放大模塊，②中的三端運(yùn)放結(jié)構(gòu)為圖2中的共模反饋結(jié)構(gòu)。Vcmfb是圖2中的Vbias電壓，反饋到差分運(yùn)算放大器調(diào)節(jié)輸出共模電平，Sl和S2由同一時(shí)鐘控制。

其工作原理如下：

在第一個(gè)時(shí)刻，開(kāi)關(guān)Sl和S2閉合，則電容Cl被短路，此時(shí)要求全差分運(yùn)算放大器的輸入短路，以使輸出差分電平為零，共模電平檢測(cè)放大模塊直接檢測(cè)全差分運(yùn)算放大器的輸出電平，并反饋電壓Vcmfb穩(wěn)定輸出共模電壓至Vcm。

下一個(gè)時(shí)刻，開(kāi)關(guān)Sl和S2都斷開(kāi)，此時(shí)進(jìn)入放大模式，全差分運(yùn)放輸出的電壓變化通過(guò)電容Cl和C2按一定比例縮放后，由共模電平檢測(cè)放大模塊（202）檢測(cè)，并反饋電壓Vcmfb至全差分運(yùn)算放大器的電流源偏置點(diǎn)，穩(wěn)定輸出共模電壓。

此新型開(kāi)關(guān)電容共模反饋結(jié)構(gòu)和傳統(tǒng)的開(kāi)關(guān)電容共模反饋結(jié)構(gòu)相比，不需要使用非交疊時(shí)鐘，開(kāi)關(guān)數(shù)量減少，引入更低噪聲，且在每一個(gè)周期共模電壓都可以完全建立，建立時(shí)間不受限制。與傳統(tǒng)的連續(xù)時(shí)間共模反饋結(jié)構(gòu)相比，輸出擺幅增加，也不會(huì)增加阻性負(fù)載。

3 仿真結(jié)果

采用HLMC 40 nm CMOS工藝設(shè)計(jì)了一款全差分運(yùn)放并運(yùn)用本設(shè)計(jì)提出的新型共模反饋結(jié)構(gòu)，基于CadenceSpectre模擬器上對(duì)其進(jìn)行仿真，仿真結(jié)果如圖4（b）和圖5（b）所示。同時(shí)給出了圖1和圖2中共模反饋的輸出曲線圖（圖4（a）和圖5（a））以作對(duì)比。

圖4 （a）為傳統(tǒng)開(kāi)關(guān)電容共模反饋瞬態(tài)仿真圖，圖4（b）為本設(shè)計(jì)的共模反饋結(jié)構(gòu)瞬態(tài)仿真圖，可以明顯看出本設(shè)計(jì)的共模反饋結(jié)構(gòu)的共模電壓建立時(shí)間大大縮短，可以保障差分運(yùn)放的快速正常工作。圖5 （a）為圖2所示的傳統(tǒng)連續(xù)時(shí)間共模反饋結(jié)構(gòu)的直流仿真圖，圖5（b）為本設(shè)計(jì)的共模反饋結(jié)構(gòu)的直流仿真圖，仿真方法為在輸入加入差分電壓，得到輸出電壓值，從對(duì)比中可見(jiàn)，本設(shè)計(jì)共模反饋結(jié)構(gòu)不會(huì)限制差分運(yùn)算放大器的輸出擺幅，可以在全輸出范圍內(nèi)穩(wěn)定輸出共模電平。

4 結(jié)論

本文分析了傳統(tǒng)共模反饋電路的原理及其存在的問(wèn)題，提出了一種新的共模反饋電路，該電路克服了傳統(tǒng)開(kāi)關(guān)電容反饋結(jié)構(gòu)對(duì)共模電平建立時(shí)間的要求，同時(shí)對(duì)差分運(yùn)放的輸出擺幅沒(méi)有影響。采用HLMC40nmCMOS工藝設(shè)計(jì)了一款全差分運(yùn)算放大器進(jìn)行仿真驗(yàn)證，結(jié)果表明該結(jié)構(gòu)具有快速的穩(wěn)定時(shí)間以及寬輸出擺幅，可廣泛應(yīng)用于全差分運(yùn)算放大器。

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