Altera公司演示了使用FPGA的浮點(diǎn)DSP新設(shè)計(jì)流程,這是基于模型的浮點(diǎn)設(shè)計(jì)工具,支持在FPGA中實(shí)現(xiàn)復(fù)數(shù)浮點(diǎn)DSP算法。Altera浮點(diǎn)DSP設(shè)計(jì)流程包括集成在DSP Builder高級(jí)模塊庫(kù)中的Altera浮點(diǎn)DSP編譯器、Quartus II RTL工具鏈、ModelSim仿真器,以及 Math-Works MATLAB和Simulink工具,簡(jiǎn)化了FPGA的DSP算法實(shí)現(xiàn)過程。浮點(diǎn)設(shè)計(jì)流程結(jié)合并集成了算法模型和仿真、RTL產(chǎn)生、綜合、布局布線以及設(shè)計(jì)驗(yàn)證級(jí)等。通過功能集成,在算法級(jí)和FPGA級(jí)實(shí)現(xiàn)了快速開發(fā)和設(shè)計(jì)空間管理,最終減少了在設(shè)計(jì)上的投入。

Altera新的設(shè)計(jì)流程適用于解決要求較高的線性代數(shù)問題,這類問題一般需要浮點(diǎn)提供的動(dòng)態(tài)范圍。BDTI測(cè)試了可參數(shù)賦值的浮點(diǎn)矩陣求逆設(shè)計(jì)。矩陣求逆是雷達(dá)系統(tǒng)、MIMO無線系統(tǒng)以及醫(yī)療成像和很多其他DSP應(yīng)用所使用的代表性處理功能。